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00:00:00,969 --> 00:00:06,049
Nous avons vu qu'un transistor est composé
par un canal semi-conducteur connecté à
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00:00:06,049 --> 00:00:10,390
deux contacts, la source et le drain, parmi
lesquels passe un courant.
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00:00:10,390 --> 00:00:17,300
Ce courant est contrôlé par le contact de
grille qui est couplé capacitivement au canal
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00:00:17,300 --> 00:00:18,300
semi-conducteur.
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00:00:18,300 --> 00:00:23,789
En fonction de la tension sur le contact de
grille on pourra donc avoir un courant qui
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00:00:23,789 --> 00:00:28,900
circule librement entre la source et le drain,
le transistor sera donc dans son état ON,
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00:00:28,900 --> 00:00:33,810
ou un courant qui est bloqué et donc le transistor
sera dans son état OFF.
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00:00:33,810 --> 00:00:40,660
Par rapport aux géométries simples qui sont
montrées dans les images de microscopie électronique
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00:00:40,660 --> 00:00:43,350
à gauche, la réalité est bien plus complexe.
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00:00:43,350 --> 00:00:50,610
Pourquoi ? Parce que on essaie de maximiser
l’effet de la grille et donc, à parité
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00:00:50,610 --> 00:00:55,310
de tension de grille, avoir un blocage bien
plus efficace du courant.
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00:00:55,310 --> 00:01:01,740
Et on essaie aussi d’utiliser le moins de
courant possible et donc d’avoir des résistances
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00:01:01,740 --> 00:01:05,210
d’accès, des résistances de source et
de drain qui soient minimum.
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00:01:05,210 --> 00:01:11,240
En plus, on aimerait avoir des transistors
qui sont peu sensibles à la température,
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00:01:11,240 --> 00:01:12,240
aux irradiations.
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00:01:12,240 --> 00:01:19,570
Donc quelles sont les géométries adoptées
? Vous avez ici plusieurs exemples, on va
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00:01:19,570 --> 00:01:20,760
vous en donner en particulier trois.
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00:01:20,760 --> 00:01:23,320
En haut à gauche, le FINFET.
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00:01:23,320 --> 00:01:30,040
Donc "FIN" est le mot anglais pour aileron
qui est notre canal semi-conducteur.
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00:01:30,040 --> 00:01:35,450
Donc on voit que ce canal est bien affiné
et qu'il est complètement entouré par la
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00:01:35,450 --> 00:01:36,450
grille.
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00:01:36,450 --> 00:01:41,370
Donc l'effet électrostatique sera bien plus
important venant de trois côtés du canal
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00:01:41,370 --> 00:01:43,580
plutôt que juste du dessus.
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00:01:43,580 --> 00:01:50,619
Un autre exemple est l'utilisation des diélectriques
entre la grille et le canal semi-conducteur
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00:01:50,619 --> 00:01:56,830
dits de high-K, donc de haute constante diélectrique,
qui à parité de tension vont donner un champ
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00:01:56,830 --> 00:02:01,260
électrique bien plus important dans le canal
semi-conducteur et donc augmenter l'efficacité
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00:02:01,260 --> 00:02:02,729
de la grille.
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00:02:02,729 --> 00:02:08,789
Un troisième exemple qu'on va développer
un peu plus est le transistor Fully Depleted
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00:02:08,789 --> 00:02:10,030
Silicon On Insulator.
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00:02:10,030 --> 00:02:14,230
Donc ce sont des transistors réalisés sur
des substrats dits SOI.
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00:02:14,230 --> 00:02:17,390
Donc du Silicium au dessus d'un isolant.
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00:02:17,390 --> 00:02:23,120
Et quels sont les intérêts de ce type de
transistor.
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00:02:23,120 --> 00:02:30,040
Le transistor est réalisé sur une fine couche
de silicium qui est isolé du substrat par
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00:02:30,040 --> 00:02:33,370
une couche amorphe d'oxyde de silicium.
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00:02:33,370 --> 00:02:42,370
De ce fait, les courants qui circulent entre
la source et le drain sont confinés au canal
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00:02:42,370 --> 00:02:43,370
semi-conducteur.
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00:02:43,370 --> 00:02:47,680
Il n'y aura pas de courants de fuite qui passent
dans le substrat et qui sont difficilement
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00:02:47,680 --> 00:02:50,560
contrôlés par la grille car elles sont assez
loin.
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00:02:50,560 --> 00:02:52,709
Donc on aura une consommation diminuée.
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00:02:52,709 --> 00:02:58,620
Ensuite, on aura aussi une meilleure tenue
aux irradiations.
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00:02:58,620 --> 00:03:02,840
Pourquoi ? Parce que la lumière qui arrive
sur le substrat de silicium, c’est-à-dire
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00:03:02,840 --> 00:03:07,190
le substrat semi-conducteur, va créer des
charges et ces charges peuvent donc fournir
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00:03:07,190 --> 00:03:11,090
des porteurs de charge, donc de la conduction,
dans le canal.
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00:03:11,090 --> 00:03:16,140
Ceci est rendu plus compliqué ou impossible
par la présence de la couche isolante.
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00:03:16,140 --> 00:03:22,690
Maintenant, quel est le coût associé à
l'utilisation de ces substrats SOI ? En fait,
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00:03:22,690 --> 00:03:30,640
il n'est pas si simple d'en réaliser car
nous avons un substrat monocristalin, une
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00:03:30,640 --> 00:03:41,530
couche isolante amorphe et au dessus un autre
substrat de silicium monocristalin qui sera
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00:03:41,530 --> 00:03:45,200
difficile à faire pousser, à épitaxier
au dessus de la couche isolante.
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00:03:45,200 --> 00:03:54,680
La réponse est que le coût des ces substrats
peut être limité grâce en particulier à
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00:03:54,680 --> 00:04:01,830
un brevet SOITEC donc d'une usine française
qui a trouvé comment réaliser des substrats
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00:04:01,830 --> 00:04:05,349
SOI de façon simple et économique.
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00:04:05,349 --> 00:04:11,080
On part d'un substrat silicium qu'on vient
oxyder thermiquement, l'oxyde thermique a
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00:04:11,080 --> 00:04:14,599
de bonnes propriétés électriques et structurelles.
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00:04:14,599 --> 00:04:20,370
On vient ensuite implanter des ions légers,
normalement de l'hydrogène.
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00:04:20,370 --> 00:04:25,190
La position de ces ions dans le silicium sera
déterminée par l'énergie d'implantation.
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00:04:25,190 --> 00:04:34,300
Ensuite, on vient coller ce wafer à un wafer
identique donc oxydé aussi en surface.
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00:04:34,300 --> 00:04:40,560
Et par simple pression, les deux couches d'oxyde
de silicium amorphe vont avoir une tenue mécanique.
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00:04:40,560 --> 00:04:49,970
Et enfin, on vient cliver donc couper le substrat
de silicium là où les atomes d'hydrogène
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00:04:49,970 --> 00:04:50,970
étaient présents.
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00:04:50,970 --> 00:04:54,630
Donc ce procédé agit comme un scalpel atomique.
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00:04:54,630 --> 00:05:03,650
On vient ensuite enlever le substrat de silicium
qui surplombe le dessin, sur lequel on repart,
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00:05:03,650 --> 00:05:10,770
on ré-oxyde thermiquement et on produit un
nouveau wafer de SOI.
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00:05:10,770 --> 00:05:18,370
Les caractéristiques, les performances des
ces transistors sont bien comparables au transistor
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00:05:18,370 --> 00:05:23,180
bulk, donc sur un substrat de silicium avec
un standard de 28 nanomètres de longueur
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00:05:23,180 --> 00:05:27,870
de canal et aux FINFET qui sont utilisés
par exemple par INTEL.
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00:05:27,870 --> 00:05:31,729
Et parfois leurs performances sont aussi meilleures.
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00:05:31,729 --> 00:05:39,480
Donc on voit que l'utilisation de différentes
géométries peut être intéressante dans
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00:05:39,480 --> 00:05:45,849
différents cas mais que ces 3 performances
seront disponibles dans l'électronique actuelle.
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